drivers/crypto: aspeed: Add Caliptra SHA ACC support
Aspeed AST27xx SoCs integrate the CPTRA 1.0 secure IP, which export a SHA accelerator interface for SoC to use. Note that CPTRA 1.0 supports only SHA384 and SHA512 and this patch is verified by the 'hash test sha384/sha512' commands. Signed-off-by: Chia-Wei Wang <chiawei_wang@aspeedtech.com>
This commit is contained in:
Chia-Wei Wang
@@ -18,3 +18,13 @@ config ASPEED_ACRY
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Enabling this allows the use of RSA/ECC operations in hardware without requiring the
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software implementations. It also improves performance and saves code size.
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config ASPEED_CPTRA_SHA
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bool "Caliptra SHA ACC for Aspeed AST27xx SoCs"
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depends on DM_HASH
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help
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Select this option to enable a driver for using the SHA accelerator provided
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by Caliptra 1.0, which is integrated in AST27xx BMC SoCs.
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Enabling this allows the use of SHA operations in hardware. Note that only
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SHA384 and SHA512 are supported by Caliptra 1.0.
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@@ -1,2 +1,3 @@
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obj-$(CONFIG_ASPEED_HACE) += aspeed_hace.o
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obj-$(CONFIG_ASPEED_ACRY) += aspeed_acry.o
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obj-$(CONFIG_ASPEED_CPTRA_SHA) += cptra_sha.o
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258
drivers/crypto/aspeed/cptra_sha.c
Normal file
258
drivers/crypto/aspeed/cptra_sha.c
Normal file
@@ -0,0 +1,258 @@
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// SPDX-License-Identifier: GPL-2.0-or-later
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/*
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* Copyright 2024 ASPEED Technology Inc.
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*/
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#include <asm/io.h>
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#include <config.h>
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#include <dm.h>
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#include <linux/bitfield.h>
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#include <linux/bitops.h>
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#include <linux/iopoll.h>
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#include <malloc.h>
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#include <u-boot/hash.h>
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#include <watchdog.h>
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/* SHA register offsets */
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#define CPTRA_SHA_LOCK 0x00
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#define CPTRA_SHA_USER 0x04
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#define CPTRA_SHA_MODE 0x08
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#define CPTRA_SHA_MODE_ENDIAN BIT(2)
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#define CPTRA_SHA_MODE_SEL GENMASK(1, 0)
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#define CPTRA_SHA_DLEN 0x10
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#define CPTRA_SHA_DATAIN 0x14
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#define CPTRA_SHA_EXEC 0x18
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#define CPTRA_SHA_STS 0x1c
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#define CPTRA_SHA_STS_SOC_LOCK BIT(1)
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#define CPTRA_SHA_STS_VLD BIT(0)
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#define CPTRA_SHA_DIGEST(n) (0x20 + ((n) << 2))
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#define CPTRA_SHA_CTRL 0x60
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#define CPTRA_SHA_CTRL_ZEROIZE BIT(0)
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enum cptra_sha_modes {
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CPTRA_SHA384_STREAM,
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CPTRA_SHA512_STREAM,
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};
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struct cptra_sha_ctx {
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enum HASH_ALGO algo;
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uint32_t dgst_len;
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};
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struct cptra_sha {
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void *regs;
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};
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static int cptra_sha_init(struct udevice *dev, enum HASH_ALGO algo, void **ctxp)
|
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{
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struct cptra_sha_ctx *cs_ctx;
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||||
struct cptra_sha *cs;
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||||
uint32_t mode;
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uint32_t reg;
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int rc;
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cs_ctx = malloc(sizeof(struct cptra_sha_ctx));
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if (!cs_ctx)
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return -ENOMEM;
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memset(cs_ctx, 0, sizeof(struct cptra_sha_ctx));
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cs_ctx->algo = algo;
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switch (algo) {
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case HASH_ALGO_SHA384:
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mode = CPTRA_SHA384_STREAM;
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||||
cs_ctx->dgst_len = 48;
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||||
break;
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||||
case HASH_ALGO_SHA512:
|
||||
mode = CPTRA_SHA512_STREAM;
|
||||
cs_ctx->dgst_len = 64;
|
||||
break;
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default:
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||||
rc = -EINVAL;
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goto free_n_out;
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};
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cs = dev_get_priv(dev);
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||||
/* get CPTRA SHA lock */
|
||||
if (readl_poll_timeout(cs->regs + CPTRA_SHA_LOCK, reg, reg == 0, 1000000))
|
||||
return -EBUSY;
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||||
/* zero clear SHA */
|
||||
writel(CPTRA_SHA_CTRL_ZEROIZE, cs->regs + CPTRA_SHA_CTRL);
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||||
|
||||
/* zero clear length */
|
||||
writel(0x0, cs->regs + CPTRA_SHA_DLEN);
|
||||
|
||||
/* set SHA mode */
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||||
reg = readl(cs->regs + CPTRA_SHA_MODE);
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||||
reg &= ~(CPTRA_SHA_MODE_SEL);
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||||
reg |= FIELD_PREP(CPTRA_SHA_MODE_SEL, mode);
|
||||
writel(reg, cs->regs + CPTRA_SHA_MODE);
|
||||
|
||||
*ctxp = cs_ctx;
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||||
|
||||
return 0;
|
||||
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||||
free_n_out:
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||||
free(cs_ctx);
|
||||
|
||||
return rc;
|
||||
}
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||||
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||||
static int cptra_sha_update(struct udevice *dev, void *ctx, const void *ibuf, uint32_t ilen)
|
||||
{
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||||
struct cptra_sha *cs;
|
||||
uint32_t din_be;
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||||
uint32_t dlen_sum;
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||||
uint8_t *p8;
|
||||
uint32_t i;
|
||||
|
||||
cs = dev_get_priv(dev);
|
||||
|
||||
/* update length */
|
||||
dlen_sum = readl(cs->regs + CPTRA_SHA_DLEN) + ilen;
|
||||
writel(dlen_sum, cs->regs + CPTRA_SHA_DLEN);
|
||||
|
||||
din_be = 0;
|
||||
for (i = 0, p8 = (uint8_t *)ibuf; i < ilen; ++i) {
|
||||
if (i && (i % sizeof(din_be) == 0)) {
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||||
writel(din_be, cs->regs + CPTRA_SHA_DATAIN);
|
||||
din_be = 0;
|
||||
}
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||||
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||||
din_be <<= 8;
|
||||
din_be |= p8[i];
|
||||
}
|
||||
|
||||
if (i % sizeof(din_be))
|
||||
din_be <<= (8 * (sizeof(din_be) - (i % sizeof(din_be))));
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||||
|
||||
writel(din_be, cs->regs + CPTRA_SHA_DATAIN);
|
||||
|
||||
return 0;
|
||||
}
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||||
|
||||
static int cptra_sha_finish(struct udevice *dev, void *ctx, void *obuf)
|
||||
{
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||||
struct cptra_sha_ctx *cs_ctx;
|
||||
struct cptra_sha *cs;
|
||||
uint32_t i, *p32;
|
||||
uint32_t sts;
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||||
|
||||
cs = dev_get_priv(dev);
|
||||
cs_ctx = (struct cptra_sha_ctx *)ctx;
|
||||
|
||||
/* trigger SHA calculation */
|
||||
writel(0x1, cs->regs + CPTRA_SHA_EXEC);
|
||||
|
||||
/* wait for completion */
|
||||
while (1) {
|
||||
sts = readl(cs->regs + CPTRA_SHA_STS);
|
||||
if (sts & CPTRA_SHA_STS_VLD)
|
||||
break;
|
||||
}
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||||
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||||
/* get the SHA digest in big-endian */
|
||||
p32 = (uint32_t *)obuf;
|
||||
for (i = 0; i < (cs_ctx->dgst_len / sizeof(*p32)); ++i, p32++)
|
||||
*p32 = be32_to_cpu(readl(cs->regs + CPTRA_SHA_DIGEST(i)));
|
||||
|
||||
/* release CPTRA SHA lock */
|
||||
writel(0x1, cs->regs + CPTRA_SHA_LOCK);
|
||||
|
||||
free(cs_ctx);
|
||||
|
||||
return 0;
|
||||
}
|
||||
|
||||
static int cptra_sha_digest_wd(struct udevice *dev, enum HASH_ALGO algo,
|
||||
const void *ibuf, const uint32_t ilen,
|
||||
void *obuf, uint32_t chunk_sz)
|
||||
{
|
||||
const void *cur, *end;
|
||||
uint32_t chunk;
|
||||
void *ctx;
|
||||
int rc;
|
||||
|
||||
rc = cptra_sha_init(dev, algo, &ctx);
|
||||
if (rc)
|
||||
return rc;
|
||||
|
||||
if (IS_ENABLED(CONFIG_HW_WATCHDOG) || CONFIG_IS_ENABLED(WATCHDOG)) {
|
||||
cur = ibuf;
|
||||
end = ibuf + ilen;
|
||||
|
||||
while (cur < end) {
|
||||
chunk = end - cur;
|
||||
if (chunk > chunk_sz)
|
||||
chunk = chunk_sz;
|
||||
|
||||
rc = cptra_sha_update(dev, ctx, cur, chunk);
|
||||
if (rc)
|
||||
return rc;
|
||||
|
||||
cur += chunk;
|
||||
schedule();
|
||||
}
|
||||
} else {
|
||||
rc = cptra_sha_update(dev, ctx, ibuf, ilen);
|
||||
if (rc)
|
||||
return rc;
|
||||
}
|
||||
|
||||
rc = cptra_sha_finish(dev, ctx, obuf);
|
||||
if (rc)
|
||||
return rc;
|
||||
|
||||
return 0;
|
||||
}
|
||||
|
||||
static int cptra_sha_digest(struct udevice *dev, enum HASH_ALGO algo,
|
||||
const void *ibuf, const uint32_t ilen, void *obuf)
|
||||
{
|
||||
/* re-use the watchdog version with input length as the chunk_sz */
|
||||
return cptra_sha_digest_wd(dev, algo, ibuf, ilen, obuf, ilen);
|
||||
}
|
||||
|
||||
static int cptra_sha_probe(struct udevice *dev)
|
||||
{
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||||
struct cptra_sha *cs = dev_get_priv(dev);
|
||||
|
||||
cs->regs = (void *)devfdt_get_addr(dev);
|
||||
if (cs->regs == (void *)FDT_ADDR_T_NONE) {
|
||||
debug("cannot map Caliptra SHA ACC registers\n");
|
||||
return -ENODEV;
|
||||
}
|
||||
|
||||
return 0;
|
||||
}
|
||||
|
||||
static int cptra_sha_remove(struct udevice *dev)
|
||||
{
|
||||
return 0;
|
||||
}
|
||||
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||||
static const struct hash_ops cptra_sha_ops = {
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||||
.hash_init = cptra_sha_init,
|
||||
.hash_update = cptra_sha_update,
|
||||
.hash_finish = cptra_sha_finish,
|
||||
.hash_digest_wd = cptra_sha_digest_wd,
|
||||
.hash_digest = cptra_sha_digest,
|
||||
};
|
||||
|
||||
static const struct udevice_id cptra_sha_ids[] = {
|
||||
{ .compatible = "aspeed,ast2700-cptra-sha" },
|
||||
{ }
|
||||
};
|
||||
|
||||
U_BOOT_DRIVER(aspeed_cptra_sha) = {
|
||||
.name = "aspeed_cptra_sha",
|
||||
.id = UCLASS_HASH,
|
||||
.of_match = cptra_sha_ids,
|
||||
.ops = &cptra_sha_ops,
|
||||
.probe = cptra_sha_probe,
|
||||
.remove = cptra_sha_remove,
|
||||
.priv_auto = sizeof(struct cptra_sha),
|
||||
.flags = DM_FLAG_PRE_RELOC,
|
||||
};
|
||||
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